Strukturierte Fertigungsdaten · 2026

Taktrückgewinnungsschaltung

Auf Basis strukturierter CNFX-Herstellerprofile wird Taktrückgewinnungsschaltung im Bereich Herstellung von Computern, elektronischen und optischen Erzeugnissen anhand von Datenrate bis Versorgungsspannung eingeordnet.

Technische Definition und Kernbaugruppe

Ein typisches Taktrückgewinnungsschaltung wird durch die Baugruppe aus Phasendetektor / Phasen-Frequenz-Detektor (PFD) und Ladungspumpe & Schleifenfilter beschrieben. Für industrielle Anwendungen werden Materialauswahl, Fertigungsprozess und Prüfbarkeit gemeinsam bewertet.

Eine Schaltung, die aus einem seriellen Datenstrom ein Taktsignal extrahiert und rekonstruiert, um eine synchrone Datenabtastung in Kommunikationssystemen zu ermöglichen.

Technische Definition

Die Taktrückgewinnungsschaltung (CDR) ist eine Komponente in Hochgeschwindigkeits-Serielkommunikationssystemen, insbesondere in Analog-Digital-Wandlern (ADCs) und Deserialisierern. Ihre Hauptfunktion besteht darin, ein stabiles, synchronisiertes Taktsignal direkt aus dem eingehenden seriellen Datenstrom zu erzeugen. Dieser zurückgewonnene Takt ist entscheidend für die genaue Abtastung der Datenbits zum optimalen Zeitpunkt, wobei Timing-Jitter, Frequenzdrift und Phasenversatz zwischen Sender und Empfänger kompensiert werden. Dadurch wird eine zuverlässige Datenübertragung und -umwandlung gewährleistet. Die Schaltung verwendet typischerweise eine Phasenregelschleife (PLL) oder eine Verzögerungsregelschleife (DLL). Sie vergleicht die Phase der eingehenden Datenflanken mit der Phase eines lokal erzeugten Takts von einem spannungsgesteuerten Oszillator (VCO). Ein Phasendetektor erzeugt ein Fehlersignal proportional zur Phasendifferenz. Dieses Fehlersignal wird gefiltert und verwendet, um die Frequenz/Phase des VCO anzupassen und ihn auf die mittlere Frequenz und Phase des eingehenden Datenstroms zu sperren. Nach dem Sperren wird der zurückgewonnene Takt verwendet, um die Abtastung der Datenbits im nachfolgenden Datenpfad auszulösen. Die CDR unterstützt Datenraten von 0,1 bis 12,5 Gbps, arbeitet mit einer einzelnen Versorgungsspannung von 1,8–3,3 V und verbraucht 50–150 mW bei maximaler Datenrate. Die Jitter-Toleranz beträgt 0,5–1,0 UI Spitze-Spitze bei einer Bitfehlerrate (BER) von 1e-12, die Sperrzeit liegt zwischen 0,1 und 10 ms, und der Betriebstemperaturbereich beträgt -40 bis 85 °C. Die Eingangsempfindlichkeit beträgt 50–200 mV differenziell Spitze-Spitze, und der Ausgangshub beträgt 400–800 mV differenziell, wählbar. Das Gerät ist in einem 4x4 mm QFN-32-Gehäuse erhältlich, RoHS-konform, und hat eine ESD-Bewertung von ±2 kV (HBM) gemäß IEC 61000-4-2. Zu den Materialien gehören Siliziumsubstrat, Kupferverbindungen und dielektrische Isolierung. Diese Spezifikationen sind Referenzbereiche; überprüfen Sie modellspezifische Werte mit dem Hersteller.

Funktionsprinzip

Die CDR-Schaltung verwendet eine Phasenregelschleife (PLL) oder eine Verzögerungsregelschleife (DLL), um einen Takt aus dem Datenstrom zurückzugewinnen. Ein Phasendetektor vergleicht die Phase der eingehenden Datenflanken mit einem lokal erzeugten Takt von einem spannungsgesteuerten Oszillator (VCO). Das resultierende Fehlersignal wird gefiltert und an den VCO angelegt, der seine Frequenz und Phase anpasst, um sie an die mittlere Frequenz und Phase der eingehenden Daten anzupassen. Nach dem Sperren wird der zurückgewonnene Takt verwendet, um die Datenbits zum optimalen Zeitpunkt abzutasten, wodurch eine genaue Datenwiederherstellung gewährleistet wird.

Technische Parameter

Technische Parameter
ParameterTypischer BereichHinweise & Auswahlkriterien
Datenrate0.1–12.5 GbpsSupports common serial standards
Versorgungsspannung1.8–3.3 VSingle supply operation
Leistungsaufnahme50–150 mWAt max data rate
Jittertoleranz0.5–1.0 UIPeak-to-peak at BER 1e-12
Einrastzeit0.1–10 msFrom power-up or reset
Betriebstemperatur-40–85 °CIndustrial grade
Eingangsempfindlichkeit50–200 mVDifferential peak-to-peak
Ausgangshub400–800 mVDifferential, selectable
GehäusetypQFN-324x4 mm, RoHS compliant
ESD Festigkeit±2 kVHBMIEC 61000-4-2

Die Bereiche sind branchenübliche Richtwerte zur Angebotsvorbereitung und keine Zusage des Lieferanten. Bestätigen Sie jeden Wert und jede Norm vor der Bestellung beim rechtlichen Hersteller.

Hauptmaterialien

Silizium (Halbleitersubstrat) Kupfer (Leiterbahnen) Dielektrische Materialien (Isolierung)

Komponenten / BOM

Components / BOM
  • Phasendetektor / Phasen-Frequenz-Detektor (PFD)
    Vergleicht die Phase (und manchmal Frequenz) der eingehenden Datenübergänge mit dem Rückkopplungstakt vom VCO und erzeugt ein Fehlersignal.
    Material: Halbleiter (CMOS/BiCMOS-Transistoren)
  • Ladungspumpe & Schleifenfilter
    Wandelt die digitalen Fehlersignale des Phasendetektors in eine analoge Steuerspannung um. Das Schleifenfilter glättet diese Spannung, um die Dynamik (Bandbreite, Stabilität) des PLLs einzustellen.
    Material: Halbleiter (Transistoren, Kondensatoren, Widerstände)
  • Spannungsgesteuerter Oszillator (VCO)
    Erzeugt das lokale Taktsignal. Seine Oszillationsfrequenz wird durch die Spannung vom Schleifenfilter gesteuert.
    Material: Halbleiter (Induktivitäten, Varaktoren, Transistoren)
  • Frequenzteiler
    Teilt die hochfrequente VCO-Ausgangsfrequenz auf eine niedrigere Frequenz herunter, um sie im Phasendetektor zu vergleichen und das Multiplikationsverhältnis der PLL festzulegen.
    Material: Halbleiter (digitale Logikgatter)

FMEA · Fehleranalyse

Ursache → Fehlermodus → Engineering-Maßnahme

Versorgungsnetzwelligkeit übersteigt 50 mVpp bei 100 kHz Phasenregelschleifen-Entriegelung verursacht Bitfehlerrate >10^-3 Low-Dropout-Regler mit <10 mV Welligkeit, π-Filter mit 10 μF Keramikkondensatoren
Eingangsdaten-Jitter übersteigt 0,3 UI Spitze-Spitze Takt-Daten-Fehlausrichtung verursacht Metastabilität in Abtast-Flipflops Jitter-Dämpfer mit <1 ps RMS additivem Jitter, adaptive Entzerrung mit 30 dB Kompensation

Technische Bewertung

Betriebsbereich
Betriebsbereich
1,5-3,3 V Eingangsspannung, 100 MHz-10 GHz Datenrate, -40°C bis 85°C Umgebungstemperatur
Belastungs- und Ausfallgrenzen
Verlust der Phasensynchronisation bei >100 ps RMS Jitter, Spannungsabfall unter 1,2 V, Temperaturüberschreitung von 125°C Sperrschichttemperatur
Totzone des Phasendetektors, die zeitliche Drift verursacht, thermisches Rauschen, das die Bandbreite der Phasenregelschleife überschreitet (typischerweise 1/20 der Datenrate), Spannungsregler-Dropout
Fertigungskontext
Taktrückgewinnungsschaltung wird innerhalb von Herstellung von Computern, elektronischen und optischen Erzeugnissen nach Material, Prozessfenster und Prüfanforderungen bewertet.

Taxonomie und Suchbegriffe

Suchbegriffe, Aliase und technische Bezeichnungen für diesen CNFX Datensatz.

Anwendungen / Eingebaute Systeme

Dieses Teil oder Produkt erscheint in den folgenden Systemen und Maschinen.

Eignung und Auslegungsdaten

Betriebsgrenzen
Betriebsdruck:N/V (elektronisches Festkörperbauelement)
Weitere Spezifikationen:Datenratenbereich: 1 Mbps bis 10 Gbps, Jitter-Toleranz: < 0,1 UI, Versorgungsspannung: 1,8 V bis 3,3 V
Betriebstemperatur:-40°C bis +85°C (Industriequalität), -40°C bis +125°C (erweitert)
Montage- und Anwendungskompatibilität
Glasfaser-KommunikationssystemeHochgeschwindigkeits-Seriendatenverbindungen (z.B. PCIe, SATA)Telekommunikations-Backplane-Schnittstellen
Nicht geeignet: Umgebungen mit hoher elektromagnetischer Störung (EMI) ohne entsprechende Abschirmung
Auslegungsdaten
  • Datenrate (bps)
  • Jitter-Spezifikation (UI oder ps)
  • Eingangssignalamplitude (mVpp)

Zuverlässigkeits- und Risikoanalyse

Ausfallmodus und Ursache
Taktjitter-Verschlechterung
Ursache: Versorgungsnetzrauschen, Temperaturschwankungen oder Alterung von Komponenten des spannungsgesteuerten Oszillators (VCO), die zu zeitlicher Instabilität führen.
Phasenregelschleifen (PLL) Verlust der Synchronisation
Ursache: Signalintegritätsprobleme (z.B. elektromagnetische Störungen, schlechte Leiterplattenlayoutgestaltung), Drift des Referenztakts oder Ausfall von Schleifenfilterkomponenten, die die Synchronisation stören.
Wartungsindikatoren
  • Erhöhte Bitfehlerrate (BER) in der Datenübertragung, die auf zeitliche Fehlausrichtung hinweist
  • Abnormale Wärmeabgabe vom PLL- oder VCO-Bereich, die auf Überstrom oder Komponentenbelastung hindeutet
Technische Hinweise
  • Implementierung einer robusten Versorgungsnetzfilterung und Entkopplung nahe der CDR-Schaltung, um rauschinduzierten Jitter zu minimieren
  • Regelmäßige Überwachung und Kalibrierung der Referenztaktquelle und Aufrechterhaltung stabiler Betriebstemperaturen, um thermische Drift zu verhindern

Konformität und Fertigungsnormen

Referenznormen
IEC 60747-14-1: Halbleiterbauelemente - Teil 14-1: Halbleitersensoren - TaktrückgewinnungsschaltungenCE-Kennzeichnung: Konformität mit der EU-EMV-Richtlinie 2014/30/EU und der Niederspannungsrichtlinie 2014/35/EU
Fertigungsgenauigkeit
  • Jitter-Toleranz: +/- 0,1 UI (Unit Interval) bei spezifizierten Datenraten
  • Frequenzgenauigkeit: +/- 100 ppm (parts per million) über den Betriebstemperaturbereich
Qualitätsprüfung
  • Bitfehlerratentest (BER-Test): Überprüfung der Signalintegrität und Wiederherstellungsgenauigkeit unter verschiedenen Bedingungen
  • Jitter-Transferfunktionsmessung: Gewährleistung der Konformität mit Jitter-Toleranz- und -Erzeugungsspezifikationen

Hersteller von Taktrückgewinnungsschaltung

Herstellerprofile mit passender Produktionsfähigkeit in China.

Die Herstellerliste dient der Vorrecherche und Einordnung von Fertigungskapazitäten. Sie ist keine Zertifizierung, kein Ranking und keine Transaktionsgarantie.

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Beispielhafte Bewertungskriterien aus Einkaufsprozessen

Keine Kundenbewertung und keine Echtzeitdaten. Die Werte zeigen typische Prüfkriterien in RFQ- und Lieferantenbewertungsprozessen.

Technische Dokumentation
4/5
Fertigungsfähigkeit
4/5
Prüfbarkeit
5/5
Lieferantentransparenz
3/5

Die Kriterien dienen als Orientierung für technische Einkaufsprüfungen. Konkrete Kunden, Länder, Bewertungsdaten oder Live-Nachfragen werden nur angezeigt, wenn entsprechende belastbare Daten vorliegen.

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Häufige Fragen

Was ist die Hauptfunktion einer Taktrückgewinnungsschaltung?

Die Hauptfunktion besteht darin, ein stabiles Taktsignal aus einem eingehenden seriellen Datenstrom zu extrahieren, um eine genaue Abtastung der Datenbits in Kommunikationssystemen zu ermöglichen.

Welche Architekturen werden üblicherweise in CDR-Schaltungen verwendet?

Übliche Architekturen sind Phasenregelschleifen (PLL) und Verzögerungsregelschleifen (DLL), die einen lokalen Oszillator an die Timing der eingehenden Daten anpassen.

Welche Datenraten unterstützt diese CDR?

Der Referenzbereich liegt bei 0,1 bis 12,5 Gbps, aber die tatsächlich unterstützten Raten hängen vom spezifischen Modell und der Konfiguration ab.

Was ist der Betriebstemperaturbereich?

Der industrielle Betriebstemperaturbereich liegt bei -40 bis 85 °C, wie in den Referenzparametern angegeben.

Kann ich Hersteller direkt kontaktieren?

CNFX ist ein offenes Verzeichnis, keine Handelsplattform und kein Beschaffungsagent. Herstellerprofile und Formulare helfen bei der Vorbereitung des direkten Kontakts.

CNFX Industrial Index v2.6.09 · Herstellung von Computern, elektronischen und optischen Erzeugnissen

Datenbasis

CNFX-Herstellerprofile, technische Klassifikation, öffentlich verfügbare Produktinformationen und fortlaufende Plausibilitätsprüfung.

Vorläufige technische Einordnung
Diese Seite dient der strukturierten Vorbereitung von Recherche, RFQ und Lieferantenbewertung. Sie ersetzt keine Lieferantenqualifizierung, keine Normenprüfung und keine technische Freigabe durch den Käufer.
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